學(xué)習(xí) FPGA，在不同層次的人明顯有不同的答案。
先說(shuō)一句，說(shuō)不要開(kāi)發(fā)板的都是菜鳥(niǎo)級(jí)選手。
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FPGA 層次可劃分為，菜鳥(niǎo)級(jí)別，老鳥(niǎo)級(jí)別，高手級(jí)別三類。
下面的內(nèi)容主要介紹如何成為一個(gè)菜鳥(niǎo)。
1）熟悉語(yǔ)法，其實(shí)你不需要什么都會(huì)，但是要記住幾個(gè)經(jīng)典的時(shí)序，邏輯電路的描述方式。
2）熟悉三個(gè)經(jīng)典電路描述并仿真。仿真其實(shí)不是很重要，我開(kāi)始學(xué)習(xí)壓根沒(méi)學(xué)那個(gè)玩意兒，因?yàn)橐侵蛔鼋涌谀峭嬉鈨簺](méi)啥用。
直接用 ChipSchop 抓抓數(shù)據(jù)更快。仿真是給做算法，工程相對(duì)較大的人用的。三個(gè)經(jīng)典電路分別是，分頻器，計(jì)數(shù)器（可做一個(gè)時(shí)鐘），序列檢測(cè)器。
這樣你就基本熟悉了開(kāi)發(fā)環(huán)境了。
3）上板卡跑一個(gè)燈，熟悉一個(gè)板卡上時(shí)鐘資源使用，硬件的使用原理。
4）知道了 FPGA 學(xué)習(xí)主要不在于編程！壓根沒(méi)有編程這回事！！
Verilog 是硬件描述語(yǔ)言！描述！！寫代碼時(shí)腦子里必須有電路圖！！知道 FPGA 主要學(xué)的是硬件和算法！！軟件最多能占 10％就不錯(cuò)了！！
只要你能完成這上面的東西，恭喜你進(jìn)入菜鳥(niǎo)行列，可以在別人設(shè)計(jì)好 FPGA 方案的條件下完成一些模塊的設(shè)計(jì)了。
其實(shí)華為招聘員工，很多人 FPGA 水平一開(kāi)始都差不多這么菜。
先寫一下老鳥(niǎo)需要會(huì)什么，以后再答怎么做到。
1）FPGA 邏輯資源，特別是時(shí)鐘資源要非常熟悉。
2）做算法的必須熟悉 sysgen 的使用。說(shuō)的容易了，sysgen 畫畫圖也沒(méi)那么容易哦，你要熟悉使用各種濾波器，理論知識(shí)要求起點(diǎn)就不小。
3）充分理解 FPGA 從上而下的設(shè)計(jì)原則，能夠編寫中等程度的 FPGA 詳細(xì)設(shè)計(jì)方案。
4）熟悉時(shí)序優(yōu)化，時(shí)序收斂，區(qū)域約束等知識(shí)。并且能運(yùn)用到編程之中，解決菜鳥(niǎo)們解決不了的“不科學(xué)”的問(wèn)題。
說(shuō)白了就是會(huì)使用 planhead，以及 ISE 中那些你還沒(méi)接觸過(guò)的功能。一般菜鳥(niǎo)們 ISE 都只會(huì)編程，默認(rèn)的編譯一下，然后下載，ChipSchop 抓抓數(shù)看看。
5）能夠熟悉 FPGA 常用的接口，不求都會(huì)編程，但是要知道他們功能是什么。比如 ADC，DAC，串口，EMIF 等等。并且熟悉 DSP 等 FPGA 周邊常用芯片工作原理。
6）熟悉硬件設(shè)計(jì)，至少要知道 Bank 上 IO 規(guī)劃怎么好，全局時(shí)鐘，區(qū)域時(shí)鐘大致怎么規(guī)劃等等。
7）信號(hào)源，示波器，頻譜儀都要熟悉使用吧！
等這些都熟悉了，差不多是老鳥(niǎo)了。
http://old.mdy-edu.com/xmucjie/2023/0201/1865.html
溫馨提示：明德?lián)P2023推出了全新課程——邏輯設(shè)計(jì)基本功修煉課，降低學(xué)習(xí)FPGA門檻的同時(shí)，增加了學(xué)習(xí)的趣味性，并組織了考試贏積分活動(dòng)
http://m.cqqtmy.cn/ffkc/415.html
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明德?lián)P除了培訓(xùn)學(xué)習(xí)還有項(xiàng)目承接業(yè)務(wù)，擅長(zhǎng)的項(xiàng)目主要包括的方向有以下幾個(gè)方面：
1. MIPI視頻拼接
2. SLVS-EC轉(zhuǎn)MIPI接口(IMX472 IMX492)
3. PCIE采集系統(tǒng)
4. 圖像項(xiàng)目
5. 高速多通道ADDA系統(tǒng)
6. 基于FPGA板卡研發(fā)
7. 多通道高靈敏電荷放大器
8. 射頻前端
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