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1.PCIE的發(fā)送和接收數(shù)據(jù)
本工程的目的是在XC7K325tffg的平臺上實現(xiàn)pcie的數(shù)據(jù)發(fā)送和接收，速率8通道2.5GB/s,首先看下本工程的PCIE部分的結(jié)構(gòu)：
架構(gòu)
各個模塊的作用
PCIE部分結(jié)構(gòu)圖
這是PCIE IP核，主要用來發(fā)送數(shù)據(jù)，發(fā)送引擎主要負責將待發(fā)送數(shù)據(jù)按照PCIE協(xié)議組織成不同類型的TLP數(shù)據(jù)包，并發(fā)送給PCIE IP核；發(fā)送DMA控制模塊主要負責把DDR3中讀取的數(shù)據(jù)轉(zhuǎn)換成TLP格式，并傳送給發(fā)送引擎；接收引擎用于從PCIE IP核接收不同類型的TLP數(shù)據(jù)，接收DMA控制模塊用于實現(xiàn)存儲器讀請求包的發(fā)送流量控制及接收數(shù)據(jù)位寬的轉(zhuǎn)換；DMA狀態(tài)控制寄存器模塊主要用來解析來自PC對模塊內(nèi)部寄存器的命令和配置，并通知發(fā)送引擎模塊、接收引擎模塊及其他模塊作出相應執(zhí)行。
圖表 SEQ 圖表 * ARABIC 1
圖表一中 左圖Rd_fifo是數(shù)據(jù)寫入緩存模塊，右圖是讀出緩存數(shù)據(jù)模塊。
Fifo:先入先出隊列。數(shù)字電路設(shè)計中所說的fifo實際是指fifo存儲器，主要用于數(shù)據(jù)緩存和異步處理，fifo存儲器緩存數(shù)據(jù)也遵循先入先出的原則。Fifo本質(zhì)是一個RAM，它與普通存儲器的區(qū)別是沒有外部讀寫地址線，這樣使用起來非常簡單，但缺點就是只能順序?qū)懭霐?shù)據(jù)，順序的讀寫數(shù)據(jù)。
信號列表
名稱 | 方向 | 位寬 | 說明 |
FIFO_read_1_empty | o | 1 | 讀fifo的空信號指示 1：讀fifo里面沒有數(shù)據(jù) 0：讀fifo里面有數(shù)據(jù) |
FIFO_READ_1_rd_data | o | 128 | 讀fifo數(shù)據(jù)的輸出 |
FIFO_READ_1_rd_en | i | 1 | 讀fifo的使能 1：讀出讀fifo里面的數(shù)據(jù) 0：不讀數(shù)據(jù) |
adc_en_1 | o | 1 | 接收到的寄存器使能 1：寄存器0x0收到數(shù)據(jù)為0x01 0：寄存器0x0收到數(shù)據(jù)為0x00 |
Axi_aclk_1 | o | 1 | PCIE 對外提供的用戶時鐘 |
axi_aresetn_1 | o | 1 | Pcie對外提供的復位 |
din_1 | i | 128 | 用戶側(cè)想要發(fā)送的數(shù)據(jù)接口 |
Lnk_up_led | o | 1 | Pcie連接指示信號 |
Pci_express_x8_rxn | i | 8 | Pcie的接收管腳n端 |
Pci_express_x8_rxp | i | 8 | Pcie的接收管腳p端 |
Pci_express_x8_txn | o | 8 | Pcie的發(fā)送端n端 |
Pci_express_x8_txp | o | 8 | Pcie的發(fā)送端p端 |
pcie_diff_dock_clk_n | i | 1 | Pcie時鐘信號n端 |
Pcie_diff_dock_clk_p | i | 1 | Pcie時鐘信號p端 |
Pcie_perstn | i | 1 | Pcie得復位管腳 |
Prog_full_1 | o | 1 | 寫fifo的滿信號 |
wr_en_1 | i | 1 | 寫fifo的寫使能 |
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2. SLVS-EC轉(zhuǎn)MIPI接口(IMX472 IMX492)
3. PCIE采集系統(tǒng)
4. 圖像項目
5. 高速多通道ADDA系統(tǒng)
6. 基于FPGA板卡研發(fā)
7. 多通道高靈敏電荷放大器
8. 射頻前端
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