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【教程】Verilog語法快速掌握(附視頻鏈接)

  發布時間:2023-10-19  |    作者:yi jin yun  |  瀏覽量:1278

(1) 快速掌握(本部分是學習verilog的重要部分,配有verilog語法介紹和訓練題目,大部分都包含有視頻。verilog內容有很多,但如果是設計的話,我們只用了很少一部分內容,明德揚的VERILOG就是學習設計部分,所以才稱之為快速掌握。)

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(2) 設計規范(本部分講述了MDY的設計規范,這僅是一般性規范,規定了信號命名、時鐘復位和一般性設計規范,應該來說是很通用的)

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(3) 測試文件(本部分是測試文件的編寫。設計文件和測試文件有很大的不同,設計文件限制性很強,只能用有限的幾種語法;而測試文件很隨意,想怎么用就怎么用。但是測試文件一般是不太關心的,寫得好寫得不好,也無所謂,能解決問題就行。所以一般公司不會規范測試文件。測試文件也要掌握一下,本部分首先講了測試文件的構成,然后是5個測試文件的進階練習,據反映還是有一定難度的,愿意挑戰的就來試下。

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